如时序逻辑电路中的存储电路受统一的时钟脉冲控制，则为同步时序逻辑电路。

发布于 2022-06-15 01:56:25

【判断题】
A 正确
B 错误

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一只蝲蝲蛄 2022-06-15

这家伙很懒，什么也没写！

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RENO

这家伙很懒，什么也没写！

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1

同步D触发器在CP=1期间，D端输入信号变化时，对输出Q端的状态没有影响。

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同步JK触发器在CP=1期间，J、K端输入信号发生变化时，输出Q端发生变化。

3

边沿JK触发器在CP=1期间，J、K端的输入信号变化时，对输出Q端没有影响。

4

边沿JK触发器在输入J=1、K=1，时钟脉冲频率64kHz，输出Q端脉冲频率32kHz。

5

时序逻辑电路由触发器和组合逻辑电路组成。

6

4位二进制计数器是一个十五分频电路。

7

同步计数器和异步计数器级联后仍为同步计数器。

8

十进制计数器只有8421BCD码一种编码方式。

9

由于每个触发器有两个稳定状态，因此，存放8位二进制数时需4个触发器。

10

电气图包括：电路图、功能表图、系统图和框图以及（）等。

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